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參數資料
| 型號： | MC68EN360ZP25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, PBGA357 |
| 封裝： | BGA-357 |
| 文件頁數： | 206/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68EN360ZP25 |
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CPU32+
5-64
MC68360 USER’S MANUAL
MOTOROLA
.
Figure 5-21. BDM Command Execution Flowchart
The serial data word is 17 bits wide—16 data bits and a status/control (S/C) bit.
Bit 16 indicates the status of CPU-generated messages as listed in Table 5-21
Command and data transfers initiated by the development system should clear bit 16. The
current implementation ignores this bit; however, Motorola reserves the right to use this bit
for future enhancements.
16
S/C
15
0
DATA FIELD
Table 5-21. CPU Generated Message Encoding
Encoding
Data
Message Type
0
xxxx
Valid Data Transfer
0
FFFF
Command Complete; Status OK
1
0000
Not Ready with Response; Come Again
1
0001
BERR Terminated Bus Cycle; Data Invalid
1
FFFF
Illegal Command
YES
NO
CONTINUE
ENTER (BDM)
ASSERT FREEZE SIGNAL
WAIT FOR COMMAND
SEND INITIAL COMMAND
LOAD COMMAND REGISTER
ENABLE SHIFT CLOCK
SHIFT OUT 17 BITS
DISABLE SHIFT CLOCK
EXECUTE COMMAND
LOAD: NOT READY/ RESPONSE
PERFORMCOMMAND
STORE RESULTS
READ RESULTS/NEW COMMAND
LOAD COMMAND REGISTER
ENABLE SHIFT CLOCK
SHIFT IN/OUT 17 BITS
DISABLE SHIFT CLOCK
READ RESULT REGISTER
IF RESULTS =
"NOT READY"
CPU32 ACTIVITY
DEVELOPMENT SYSTEM ACTIVITY
相關PDF資料 |
PDF描述 |
|---|---|
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| MC68MH360FE33 | QUad Integrated Communications Controller Users Manual |
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相關代理商/技術參數 |
參數描述 |
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| MC68EN360ZP33L | 功能描述:IC MPU QUICC 32BIT 33MHZ 357PBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點:- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，FCBGA 供應商設備封裝:783-FCPBGA（29x29） 包裝:托盤 |
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