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參數(shù)資料
| 型號： | EP2S15F484C5N |
| 廠商： | Altera |
| 文件頁數(shù)： | 433/768頁 |
| 文件大小： | 0K |
| 描述： | IC STRATIX II FPGA 15K 484-FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 20 |
| 系列： | Stratix® II |
| LAB/CLB數(shù)： | 780 |
| 邏輯元件/單元數(shù)： | 15600 |
| RAM 位總計： | 419328 |
| 輸入/輸出數(shù)： | 342 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BBGA |
| 供應(yīng)商設(shè)備封裝： | 484-FBGA（23x23） |
| 其它名稱： | 544-1876 EP2S15F484C5N-ND |
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Altera Corporation
5–5
January 2008
Stratix II Device Handbook, Volume 2
High-Speed Differential I/O Interfaces with DPA in Stratix II and Stratix II GX Devices
Table 5–3 shows the total number of differential channels available in
Stratix II GX devices. Non-dedicated clocks in the left bank can also be
used as data receiver channels. The total number of receiver channels
includes these four non-dedicated clock channels. Pin migration is
available for different size devices in the same package.
EP2S180
88 transmitters
92 receivers
156 transmitters
156 receivers
Notes to Table 5–2:
(1)
Pin count does not include dedicated PLL input pins.
(2)
The total number of receiver channels includes the four non-dedicated clock channels that can optionally be used as data
channels.
(3)
Within the 1,508-pin FineLine BGA package, 92 receiver channels and 92 transmitter channels are vertically migratable.
Table 5–2. Differential Channels in Stratix II Devices (Part 2 of 2) Notes (1), (2), and (3)
Device
484-Pin
FineLine BGA
484-Pin Hybrid
FineLine BGA
672-Pin
FineLine BGA
780-Pin
FineLine BGA
1,020-Pin
FineLine BGA
1,508-Pin
FineLine BGA
Within the
1,508-pin Fin
Table 5–3. Differential Channels in Stratix II GX Devices
Device
780-Pin FineLine
BGA
1,152-Pin FineLine
BGA
1,508-Pin FineLine
BGA
EP2SGX30
29 transmitters
31receivers
EP2SGX60
29 transmitters
31 receivers
42 transmitters
42 receivers
EP2SGX90
45 transmitters
47 receivers
59 transmitters
59 receivers
EP2SGX130
71 transmitters
73 receivers
Notes to Table 5–3:
(1)
Pin count does not include dedicated PLL input pins.
(2)
The total number of receiver channels includes the four non-dedicated clock
channels that can optionally be used as data channels.
(3)
EP2SGX30CF780 devices with four transceiver channels are vertically migratable to
EP2SGX60CF780 devices with four transceiver channels. EP2SGX30DF780 devices
with eight transceiver channels are vertically migratable to EP2SGX60DF780
devices with eight transceiver channels. EP2SGX60EF1152 devices with 12
transceiver channels are vertically migratable to EP2SGX90EF1152 devices with 12
transceiver channels. EP2SGX90FF1508 devices with 16 transceiver channels are
vertically migratable to EP2SGX130GF1508 devices with 20 transceiver channels.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| EP2S15F672C3 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S15F672C3N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S15F672C4 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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