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參數(shù)資料
| 型號： | EP2S15F484C5N |
| 廠商： | Altera |
| 文件頁數(shù)： | 80/768頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX II FPGA 15K 484-FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 20 |
| 系列： | Stratix® II |
| LAB/CLB數(shù)： | 780 |
| 邏輯元件/單元數(shù)： | 15600 |
| RAM 位總計： | 419328 |
| 輸入/輸出數(shù)： | 342 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BBGA |
| 供應(yīng)商設(shè)備封裝： | 484-FBGA（23x23） |
| 其它名稱： | 544-1876 EP2S15F484C5N-ND |
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5–24
Altera Corporation
Stratix II Device Handbook, Volume 1
April 2011
Timing Model
Table 5–34. Output Timing Measurement Methodology for Output Pins
I/O Standard
Loading and Termination
Measurement
Point
RS (
Ω)RD (Ω)RT (Ω)VCCIO (V) VTT (V) CL (pF)
VMEAS (V)
LVTTL (4)
3.135
0
1.5675
LVCMOS (4)
3.135
0
1.5675
2.5 V (4)
2.375
0
1.1875
1.8 V (4)
1.710
0
0.855
1.5 V (4)
1.425
0
0.7125
PCI (5)
2.970
10
1.485
PCI-X (5)
2.970
10
1.485
SSTL-2 Class I
25
50
2.325
1.123
0
1.1625
SSTL-2 Class II
25
2.325
1.123
0
1.1625
SSTL-18 Class I
25
50
1.660
0.790
0
0.83
SSTL-18 Class II
25
1.660
0.790
0
0.83
1.8-V HSTL Class I
50
1.660
0.790
0
0.83
1.8-V HSTL Class II
25
1.660
0.790
0
0.83
1.5-V HSTL Class I
50
1.375
0.648
0
0.6875
1.5-V HSTL Class II
25
1.375
0.648
0
0.6875
1.2-V HSTL with OCT
50
1.140
0
0.570
Differential SSTL-2 Class I
50
2.325
1.123
0
1.1625
Differential SSTL-2 Class II
25
2.325
1.123
0
1.1625
Differential SSTL-18 Class I
50
1.660
0.790
0
0.83
Differential SSTL-18 Class II
25
1.660
0.790
0
0.83
1.5-V Differential HSTL Class I
50
1.375
0.648
0
0.6875
1.5-V Differential HSTL Class II
25
1.375
0.648
0
0.6875
1.8-V Differential HSTL Class I
50
1.660
0.790
0
0.83
1.8-V Differential HSTL Class II
25
1.660
0.790
0
0.83
LVDS
100
2.325
0
1.1625
HyperTransport
100
2.325
0
1.1625
LVPECL
100
3.135
0
1.5675
Notes to Table 5–34:
(1)
Input measurement point at internal node is 0.5
× VCCINT.
(2)
Output measuring point for VMEAS at buffer output is 0.5 × VCCIO.
(3)
Input stimulus edge rate is 0 to VCC in 0.2 ns (internal signal) from the driver preceding the I/O buffer.
(4)
Less than 50-mV ripple on VCCIO and VCCPD, VCCINT = 1.15 V with less than 30-mV ripple
(5)
VCCPD = 2.97 V, less than 50-mV ripple on VCCIO and VCCPD, VCCINT = 1.15 V
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