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參數資料
| 型號： | EP2S15F484C5N |
| 廠商： | Altera |
| 文件頁數： | 626/768頁 |
| 文件大小： | 0K |
| 描述： | IC STRATIX II FPGA 15K 484-FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 20 |
| 系列： | Stratix® II |
| LAB/CLB數： | 780 |
| 邏輯元件/單元數： | 15600 |
| RAM 位總計： | 419328 |
| 輸入/輸出數： | 342 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BBGA |
| 供應商設備封裝： | 484-FBGA（23x23） |
| 其它名稱： | 544-1876 EP2S15F484C5N-ND |
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8–2
Altera Corporation
Stratix II Device Handbook, Volume 2
January 2008
Functional Description
Functional
Description
The dedicated remote system upgrade circuitry in Stratix II and
Stratix II GX FPGAs manages remote configuration and provides error
detection, recovery, and status information. User logic or a Nios processor
implemented in the FPGA logic array provides access to the remote
configuration data source and an interface to the system’s configuration
memory.
Stratix II and Stratix II GX FPGA’s remote system upgrade process
involves the following steps:
1.
A Nios processor (or user logic) implemented in the FPGA logic
array receives new configuration data from a remote location. The
connection to the remote source is a communication protocol such
as the transmission control protocol/Internet protocol (TCP/IP),
peripheral component interconnect (PCI), user datagram protocol
(UDP), universal asynchronous receiver/transmitter (UART), or a
proprietary interface.
2.
The Nios processor (or user logic) stores this new configuration data
in non-volatile configuration memory. The non-volatile
configuration memory can be any standard flash memory used in
conjunction with an intelligent host (for example, a MAX device or
microprocessor), the serial configuration device, or the enhanced
configuration device.
3.
The Nios processor (or user logic) initiates a reconfiguration cycle
with the new or updated configuration data.
4.
The dedicated remote system upgrade circuitry detects and recovers
from any error(s) that might occur during or after the
reconfiguration cycle, and provides error status information to the
user design.
相關PDF資料 |
PDF描述 |
|---|---|
| REC3-4809SRWZ/H/B | CONV DC/DC 3W 18-72VIN 09VOUT |
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相關代理商/技術參數 |
參數描述 |
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| EP2S15F672C3N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S15F672C4 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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