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參數資料
| 型號： | EP2S15F484C5N |
| 廠商： | Altera |
| 文件頁數： | 657/768頁 |
| 文件大小： | 0K |
| 描述： | IC STRATIX II FPGA 15K 484-FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 20 |
| 系列： | Stratix® II |
| LAB/CLB數： | 780 |
| 邏輯元件/單元數： | 15600 |
| RAM 位總計： | 419328 |
| 輸入/輸出數： | 342 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BBGA |
| 供應商設備封裝： | 484-FBGA（23x23） |
| 其它名稱： | 544-1876 EP2S15F484C5N-ND |
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8–30
Altera Corporation
Stratix II Device Handbook, Volume 2
January 2008
System Design Guidelines
The MAX II device or microprocessor and flash configuration can use
FPP, PS, or PPA. Decompression and design security features are
supported in the FPP (requires 4× DCLK) and PS modes only. Figure 8–9
shows a system block diagram for remote system upgrade with the
MAX II device or microprocessor and flash.
Figure 8–9. System Block Diagram for Remote System Upgrade With MAX II
Device or Microprocessor and Flash Device
Notes to Figure 8–9:
(1)
Connect the pull-up resistor to a supply that provides an acceptable input signal
for the device.
(2)
Connect RUnLU to GND or VCC to select between remote and local update modes.
(3)
Connect MSEL[3..0] to 0100 to enable remote update remote system upgrade
mode.
Remote System Upgrade with Enhanced Configuration Devices
■
Enhanced Configuration devices support remote system upgrade
with FPP or PS configuration schemes. The Stratix II or Stratix II GX
decompression and design security features are only supported in
the PS mode. The enhanced configuration device’s decompression
feature is supported in both PS and FPP schemes.
■
In remote update mode, neither the factory configuration nor the
application configurations should alter the enhanced configuration
device’s option bits or the page 000 factory configuration data. This
ensures that an error during remote update can always be resolved
by reverting to the factory configuration located at page 000.
External Host
(MAX II Device or
Microprocessor)
CONF_DONE
nSTATUS
nCE
DATA[7..0]
nCONFIG
Stratix II/Stratix II GX Device
Memory
ADDR DATA[7..0]
GND
MSEL[3..0]
VCC (1)
DCLK
nCEO
N.C.
10 k
Ω
10 k
Ω
PGM[2..0]
RUnLU
(2)
(3)
相關PDF資料 |
PDF描述 |
|---|---|
| REC3-4809SRWZ/H/B | CONV DC/DC 3W 18-72VIN 09VOUT |
| EPF10K40RC240-4 | IC FLEX 10K FPGA 40K 240-RQFP |
| TPSD227K006S0100 | CAP TANT 220UF 6.3V 10% 2917 |
| HAZ331MBABRBKR | CAP CER 330PF 1KV 20% RADIAL |
| NCP1086ST-33T3G | IC REG LDO 3.3V 1.5A SOT223 |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| EP2S15F672C3 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S15F672C3N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S15F672C4 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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