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參數(shù)資料
| 型號： | EP2S15F484C5N |
| 廠商： | Altera |
| 文件頁數(shù)： | 46/768頁 |
| 文件大小： | 0K |
| 描述： | IC STRATIX II FPGA 15K 484-FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 20 |
| 系列： | Stratix® II |
| LAB/CLB數(shù)： | 780 |
| 邏輯元件/單元數(shù)： | 15600 |
| RAM 位總計(jì)： | 419328 |
| 輸入/輸出數(shù)： | 342 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BBGA |
| 供應(yīng)商設(shè)備封裝： | 484-FBGA（23x23） |
| 其它名稱： | 544-1876 EP2S15F484C5N-ND |
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1–2
Altera Corporation
Stratix II Device Handbook, Volume 1
May 2007
Features
■
Support for numerous single-ended and differential I/O standards
■
High-speed differential I/O support with DPA circuitry for 1-Gbps
performance
■
Support for high-speed networking and communications bus
standards including Parallel RapidIO, SPI-4 Phase 2 (POS-PHY
Level 4), HyperTransport technology, and SFI-4
■
Support for high-speed external memory, including DDR and DDR2
SDRAM, RLDRAM II, QDR II SRAM, and SDR SDRAM
■
Support for multiple intellectual property megafunctions from
Altera MegaCore functions and Altera Megafunction Partners
Program (AMPPSM) megafunctions
■
Support for design security using configuration bitstream
encryption
■
Support for remote configuration updates
Table 1–1. Stratix II FPGA Family Features
Feature
EP2S15
EP2S30
EP2S60
EP2S90
EP2S130
EP2S180
ALMs
6,240
13,552
24,176
36,384
53,016
71,760
Adaptive look-up tables (ALUTs) (1)
12,480
27,104
48,352
72,768
106,032
143,520
Equivalent LEs (2)
15,600
33,880
60,440
90,960
132,540
179,400
M512 RAM blocks
104
202
329
488
699
930
M4K RAM blocks
78
144
255
408
609
768
M-RAM blocks
0
124
69
Total RAM bits
419,328
1,369,728
2,544,192
4,520,488
6,747,840
9,383,040
DSP blocks
12
16
36
48
63
96
18-bit × 18-bit multipliers (3)
48
64
144
192
252
384
Enhanced PLLs
2
4
Fast PLLs
4
488
88
Maximum user I/O pins
366
500
718
902
1,126
1,170
Notes to Table 1–1:
(1)
One ALM contains two ALUTs. The ALUT is the cell used in the Quartus II software for logic synthesis.
(2)
This is the equivalent number of LEs in a Stratix device (four-input LUT-based architecture).
(3)
These multipliers are implemented using the DSP blocks.
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PDF描述 |
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| EP2S15F672C3N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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