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參數資料
| 型號： | EP2S15F484C5N |
| 廠商： | Altera |
| 文件頁數： | 496/768頁 |
| 文件大小： | 0K |
| 描述： | IC STRATIX II FPGA 15K 484-FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 20 |
| 系列： | Stratix® II |
| LAB/CLB數： | 780 |
| 邏輯元件/單元數： | 15600 |
| RAM 位總計： | 419328 |
| 輸入/輸出數： | 342 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BBGA |
| 供應商設備封裝： | 484-FBGA（23x23） |
| 其它名稱： | 544-1876 EP2S15F484C5N-ND |
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Altera Corporation
6–29
January 2008
Stratix II Device Handbook, Volume 2
DSP Blocks in Stratix II and Stratix II GX Devices
Figure 6–13. Four-Multiplier Adder Mode
Notes to Figure 6–13:
(1)
These signals are not registered or registered once to match the data path pipeline.
(2)
You should send these signals through the pipeline register to match the latency of the data path.
(3)
These signals match the latency of the data path.
(4)
The rounding and saturation is only supported in 18- × 18-bit signed multiplication for Q1.15 inputs.
signa (2)
signb (2)
addnsub1/3_round (2)
addnsub3 (2)
addnsub1 (2)
Adder
Adder/
Subtractor/
Accumulator
1
PRN
CLRN
DQ
ENA
Q1.15
Round/
Saturate
Data A 1
Data B 1
shiftinb
shiftina
CLRN
DQ
ENA
CLRN
DQ
ENA
aclr[3..0]
clock[3..0]
ena[3..0]
signa (1)
signb (1)
mult_saturate (1)
mult_round (1)
mult1_is_saturated (3)
mult0_is_saturated (3)
Q1.15
Rounding
PRN
CLRN
DQ
ENA
PRN
CLRN
DQ
ENA
shiftouta
shiftoutb
Data A 2
Data B 2
DQ
ENA
CLRN
DQ
ENA
Adder/
Subtractor/
Accumulator
1
Data A 1
Data B 1
CLRN
DQ
ENA
CLRN
DQ
ENA
CLRN
DQ
ENA
Data Out 1
mult1_is_saturated (3)
mult0_is_saturated (3)
Q1.15
Rounding
Data A 2
Data B 2
DQ
ENA
CLRN
DQ
ENA
PRN
CLRN
DQ
ENA
Q1.15
Round/
Saturate
PRN
CLRN
DQ
ENA
PRN
CLRN
DQ
ENA
Q1.15
Round/
Saturate
PRN
CLRN
DQ
ENA
PRN
CLRN
DQ
ENA
PRN
CLRN
DQ
ENA
PRN
CLRN
DQ
ENA
PRN
CLRN
DQ
ENA
Q1.15
Round/
Saturate
PRN
CLRN
DQ
ENA
(4)
相關PDF資料 |
PDF描述 |
|---|---|
| REC3-4809SRWZ/H/B | CONV DC/DC 3W 18-72VIN 09VOUT |
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參數描述 |
|---|---|
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| EP2S15F672C3N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S15F672C4 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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