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參數資料
| 型號： | EP2S15F484C5N |
| 廠商： | Altera |
| 文件頁數： | 595/768頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX II FPGA 15K 484-FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 20 |
| 系列： | Stratix® II |
| LAB/CLB數： | 780 |
| 邏輯元件/單元數： | 15600 |
| RAM 位總計： | 419328 |
| 輸入/輸出數： | 342 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BBGA |
| 供應商設備封裝： | 484-FBGA（23x23） |
| 其它名稱： | 544-1876 EP2S15F484C5N-ND |
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7–82
Altera Corporation
Stratix II Device Handbook, Volume 2
January 2008
Passive Parallel Asynchronous Configuration
Figure 7–34 shows the timing waveform for the PPA configuration
scheme when using a strobed nRS and nWS signal.
Figure 7–34. Stratix II and Stratix II GX PPA Configuration Timing Waveform Using nRS and nWS Note (1)
Notes to Figure 7–34:
(1)
The beginning of this waveform shows the device in user-mode. In user-mode, nCONFIG, nSTATUS and
CONF_DONE
are at logic high levels. When nCONFIG is pulled low, a reconfiguration cycle begins.
(2)
Upon power-up, Stratix II and Stratix II GX devices hold nSTATUS low for the time of the POR delay.
(3)
Upon power-up, before and during configuration, CONF_DONE is low.
(4)
The user can toggle nCS or CS during configuration if the design meets the specification for tCSSU, tWSP, and tCSH.
(5)
DATA[7..0]
, CS, nCS, nWS, nRS, and RDYnBSY are available as user I/O pins after configuration and the state of
theses pins depends on the dual-purpose pin settings.
(6)
DATA7
is a bidirectional pin. It is an input for configuration data input, but it is an output to show the status of
RDYnBSY
.
Table 7–18 defines the timing parameters for Stratix II and Stratix II GX
devices for PPA configuration.
Byte 0
Byte 1
Byte n
nCONFIG
(2) nSTATUS
(3) CONF_DONE
(4) nCS
(4) CS
DATA[7..0]
nWS
nRS
INIT_DONE
User I/O
(6) DATA7/RDYnBSY
tCSSU
tCFG
tWSP
tWS2RS
tDH
tBUSY
tCSH
tDSU
tCF2WS
(5)
tCD2UM
tRS2WS
tCF2ST1
tCF2SCD
tSTATUS
tWS2RS
tWS2B
tRDY2WS
(5)
User-Mode
High-Z
tRSD7
Table 7–18. PPA Timing Parameters for Stratix II and Stratix II GX Devices (Part 1 of 2)
Symbol
Parameter
Min
Max
Units
tCF2CD
nCONFIG
low to CONF_DONE low
800
ns
tCF2ST0
nCONFIG
low to nSTATUS low
800
ns
相關PDF資料 |
PDF描述 |
|---|---|
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參數描述 |
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| EP2S15F672C3N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix II 780 LABs 366 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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