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參數資料
| 型號： | EP2S15F484C5N |
| 廠商： | Altera |
| 文件頁數： | 717/768頁 |
| 文件大小： | 0K |
| 描述： | IC STRATIX II FPGA 15K 484-FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 20 |
| 系列： | Stratix® II |
| LAB/CLB數： | 780 |
| 邏輯元件/單元數： | 15600 |
| RAM 位總計： | 419328 |
| 輸入/輸出數： | 342 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BBGA |
| 供應商設備封裝： | 484-FBGA（23x23） |
| 其它名稱： | 544-1876 EP2S15F484C5N-ND |
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11–8
Altera Corporation
Stratix II Device Handbook, Volume 2
May 2007
Transmission Line Layout
layouts. Thus, to achieve the same impedance, the dielectric span must be
greater in stripline layouts compared with microstrip layouts. Therefore,
stripline-layout PCBs with controlled impedance lines are thicker than
microstrip-layout PCBs.
Figure 11–8 shows stripline trace impedance with changing trace
thickness, using the stripline impedance equation, keeping trace width
and dielectric height constant. Figure 11–8 shows that the characteristic
impedance decreases as the trace thickness increases.
Figure 11–8. Stripline Trace Impedance with Changing Trace Thickness
Propagation Delay
Propagation delay (tPD) is the time required for a signal to travel from one
point to another. Transmission line propagation delay is a function of the
dielectric constant of the material.
Microstrip Layout Propagation Delay
You can use the following equation to calculate the microstrip trace layout
propagation delay:
Stripline Layout Propagation Delay
You can use the following equation to calculate the stripline trace layout
propagation delay.
60
50
40
30
20
10
0
0.7
1.4
2.8
4.2
T (mil)
Z0 (Ω)
Z0
H = 24.0 mils
W = 9.0 mils
tPD (microstrip) =
0.475
ε
r + 0.67
85
tPD (stripline) =
ε
r
85
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